CPCI嵌入式系統電源
西南林學院 張晴暉 李俊荻 文菠 徐安排
1 引言
嵌入式系統應用于和通信領域。而這些系統運行速度，系統較復雜，常常集成大規模FPGA器件、DSP器件、DDR存儲器以及接口電路。這對電源的輸出電壓值、功耗、電壓、上電順序以及電源完整提出的要求。這里介紹種基于CPCI的嵌入式單板計算機電源的設計方案。該設計主要應用于設備和車載設備。
2 系統電源需求分析與器件造型
圖1為系統整體結構框圖。該系統由CPU和與其相連的DDR儲存器、PCI接口、時鐘、電源、EBC總線以及外部接口電路組成。CPU采用AMCC公司的PowerPC 440EPx。
2．1 系統電源需求
該系統電源較復雜，有多達8種不同的電源電壓值，其中5 V和3．3 V由CPCI機箱提供。5 V供給DC／DC器件降壓以產生其他電源電壓，同時給1553總線的變壓器供電。3．3 V是系統主電源，包括USB PHY、時鐘器件、FPGA和CPU以及PCI橋器件（PLX6466）的I／O部分等。其他電源電壓都是由5V或3．3 V經電源器件降壓得到。
表1、2分別為CPU和PCI橋器件的功耗需求，CPU器件對上電順序沒有要求。其中VDD 1．5 V是PPC440EPx的內核電壓，SOVDD是CPU的DDR2接口電源；1．8 V為PCI橋的內核電壓，VDDIO是PCI橋的接口電源。
該系統采用DDR2作為內存，使用4片Micron公司的MT47H64M16，容量為512 MB。每片DDR2器件的內核、接口和DLL的電源電壓都是1．8 V，zui大電流為440 mA。另外需特別注意DDR2的VREF以及地址和信號的端口接電壓VTT，其電壓值都是0．9 V。其中，VREF對容差的要求嚴格（小于2％），不過其對電流的要求較小。而對VTT不有嚴格的容差要求，而且還要求其能在瞬間輸出或吸收很大的電流。同時，VREF岍要隨著VDD的變化而變化，VTT也要跟蹤VREF的變化。通常的LDO難以完成這樣的工作，必須采用的DDR端接電源器件。
該系統使用Spartan3型FPGA器件XC3S200實現1553收發器以及些接口電路的設計。該器件使用3個電壓內核電壓VCCINT（1．2 V），輔助電壓VCCAUX（2．5 V）以及接口電壓VCCO（3．3 V）。FPGA內部有上電復位電路，只有當這3個電源信號都達到各自門限電壓，才釋放該復位信號。因此，對這3個電源信號的上電順序沒有要求。不過，如果 VCCINT先于VCCAUX上電，則會在上電時額外增加幾百毫安的瞬時電流。估計FPGA器件功耗可采用基于電子數據表的工具XPower Estimator（XPE）或在ISE下直接調用XPower。系統利用XPower軟件估計出該設計功耗需求：VCCINT為50 mA，VCCAUX為10 mA。系統使用兩片88E1111作為千兆以太網的PHY器件，該器件以2．5 V為砌電壓（410 mA），1．0 V為內核電壓（250 mA）。除上述集成電路外，系統還有諸如串行接口、USB接口、時鐘等電路，但功耗都較低。從分析可知：1．5 V和1．8 V需要使用大功率的電源器件，DDR2的電源需要的電源器件，其他電壓的功率要求較小。
2．2 電源器件選型
電源器件主要分為線穩壓器和DC／DC轉換器兩大類型。LDO屬于線穩壓器主要應用于輸人和輸出壓差較小的場合，其特點是：成本低、噪音低、靜態電流小、需外接元件少，但其轉換效率不是很，且輸出電流般不是很大。DC／DC轉換器的轉換效率、輸出大電流、靜態電流小。但由于采用PWM，其開關噪音較大，成本也相對較。且外接電路較復雜，般都需外接開關管、電感及電容。許多 DC／DC將開關管集成到器件內部．因此只需外接電感和濾波電容。
根據電源器件的特點，以及對系統電源需求的分析，這兩種類型的電源器件在該系統都得到使用。但為簡化設計、便于批量生產和物料管理，該系統只使用3個不同型號的電源器件，分別是：LT3501、LDO器件TPS51100和TPS74801。其中，功耗需求較大的1．5 V和1．8 V電源電路采用LT3501實現；DDR2的端接電源和參考電源由器件TPS51100提供；系統的其他電源由TPS74801提供。
3 系統硬件電路設計
由于LDO電路簡單及篇幅原因，這里重點討論LT3501的電路設計，圖2為LT3501的電路原理圖。
3．1 參數配置
3．1．1 輸出電壓
輸出電壓值的選擇較簡單，由連接在VOUT和VFR間的2只電阻分壓得到。其公式為：
圖2中，分壓電阻為2只為1％的電阻R680和R682（分別對應R1，R2），代入式（1），計算其輸出電壓VOUT=1．495 V。
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更新時間：2013-04-28 
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